在VHDL的FOR_LOOP语句中的循环变量是一个临时变量，属于LOOP语句的局部量，()事先声明。
A.必须
B.不必
C.其类型要
D.其属性要
出自：河南理工大学FPGA 原理与应用

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完成拼图验证

按住下方滑块，将拼图拖到缺口处后松开。

拼图背景，将小拼图拖到缺口处
向右拖动滑块

松手后自动验证