[填空题,4分] （）仿真是对综合后的网表进行的仿真，它验证设计模块的基本逻辑功能，但不带有布局布线后产生的时序信息，是理想情况下的验证。
出自：河南理工大学FPGA 原理与应用

提示：
每天可免费获取10次答案

收藏本站【zk.995w.com】，下次访问不迷路

本站试题总数:【10253414】个 (题库试题定时更新)

完成拼图验证

按住下方滑块，将拼图拖到缺口处后松开。

拼图背景，将小拼图拖到缺口处
向右拖动滑块

松手后自动验证